CY7C1345G-133AXC
CY7C1345G-133AXC
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- 商品型号
- CY7C1345G-133AXC
- 商品编号
- C2955566
- 商品封装
- LQFP-100(14x20)
- 包装方式
- 管装
- 商品毛重
- 1克(g)
商品参数
| 属性 | 参数值 | |
|---|---|---|
| 商品目录 | 静态随机存取存储器(SRAM) | |
| 接口类型 | 并口(Parallel) | |
| 存储容量 | 4Mbit | |
| 工作电压 | 3.135V~3.6V | |
| 读写时间 | 6.5ns |
| 属性 | 参数值 | |
|---|---|---|
| 工作温度 | 0℃~+70℃ | |
| 工作电流 | 225mA | |
| 待机电流 | 40mA | |
| 功能特性 | 自动掉电功能 |
商品概述
CY7C1345G 是一款 128K x 36 同步缓存 RAM,设计用于与高速微处理器接口,所需外部逻辑最少。从时钟上升沿的最大访问延迟为 6.5 ns (133 MHz 版本)。一个两位片上计数器捕获突发中的第一个地址,并自动递增地址以进行后续突发访问。所有同步输入由正边沿触发的时钟输入 (CLK) 控制的寄存器门控。同步输入包括所有地址、所有数据输入、地址流水线芯片使能 (CE1)、深度扩展芯片使能 (CE2 和 CE3)、突发控制输入 (ADSC、ADSP 和 ADV)、写入使能 (BWx 和 BWE) 以及全局写入 (GW)。异步输入包括输出使能 (OE) 和 ZZ 引脚。该器件支持交错或线性突发序列,由 MODE 输入引脚选择。高电平选择交错突发序列,低电平选择线性突发序列。突发访问由处理器地址选通 (ADSP) 或缓存控制器地址选通 (ADSC) 输入启动。地址和芯片使能在地址选通处理器 (ADSP) 或地址选通控制器 (ADSC) 有效时,在时钟上升沿注册。后续突发地址由前进引脚 (ADV) 控制内部生成。该器件工作于 +3.3V 核心电源供应,而所有输出工作于 +2.5V 或 +3.3V 电源。所有输入和输出符合 JEDEC 标准 JESD8-5。
商品特性
- 128K x 36 通用输入输出
- 3.3V 核心电源供应 (VDD)
- 2.5V 或 3.3V 输入输出电源供应 (VDDQ)
- 快速时钟到输出时间 6.5 ns (133 MHz 版本)
- 提供高性能 2-1-1-1 访问速率
- 用户可选的突发计数器,支持交错或线性突发序列
- 独立的处理器和控制器地址选通
- 同步自定时写入
- 异步输出使能
- 提供无铅 100引脚 TQFP 封装,无铅和非无铅 119球 BGA 封装
- ZZ 睡眠模式选项
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