TLK10232CTR
具有交叉点的双通道XAUI/10GBASE-KR收发器
- 描述
- 双通道多速率收发器,支持XAUI和10GBASE-KR以太网标准,数据速率高达10.3125Gbps。
- 品牌名称
- TI(德州仪器)
- 商品型号
- TLK10232CTR
- 商品编号
- C1544648
- 商品封装
- FCBGA-144(13x13)
- 包装方式
- 托盘
- 商品毛重
- 1.42克(g)
商品参数
| 属性 | 参数值 | |
|---|---|---|
| 商品目录 | 其他接口 | |
| 接口类型 | XAUI |
| 属性 | 参数值 | |
|---|---|---|
| 数据速率 | 10.3125Gbps | |
| 工作温度 | -40℃~+85℃ |
商品概述
TLK10232 是一款双通道多速率收发器,用于高速双向点到点数据传输系统中。这个器件支持三个主模式,可被用作一个XAUI 到10GBASE-KR 的收发器、一个通用8b/10b 多速率4:1,2:1,1:1 串行器/解串行器,或者被用在1G-KX 模式中。 运行在10GBASE-KR 模式中时,TLK10232 将出现在其低速(LS) 端数据输入上的8B/10B 经编码XAUI 数据流串行化。经串行化的8B/10B 经编码数据以64B/66B 编码格式出现在高速(HS) 端输出上。相似的,TLK10232 对出现在其高速端数据输入上的64B/66B 经编码数据流进行解串操作。格式为XAUI8B/10B 的经解串行化64B/66B 数据出现在低侧端输出上。这个模式支持链路协商以及针对扩展长度应用的前向纠错(FEC)。 当运行在通用SERDES 模式时,TLK10232 将出现在其低速(LS) 端数据输入上的8B/10B 经编码数据流进行2:1 和4:1 串化。经串化的8B/10B 编码数据出现在高速(HS) 输出上。相似的,TLK10232 将出现在其高速端数据输入上的8B/10B 编码数据流进行1:2 和1:4 解串化。经解串化的8B/10B 编码数据出现在低速端输出上。根据串化/解串化比率,低速端数据传输速率范围介于0.5Gbps 至5Gbps 之间,而高速端数据传输速率介于1Gbps 至10Gbps 之间。还支持1:1 重定时模式,但是速率限制在1Gbps 至5Gbps。 TLK10232 还支持具有PCS (CTC) 功能的1G-KX (1.25Gbps) 模式。通过软件服务开通或者自动协商可启用这个模式。如果使用了软件服务开通,那么支持的数据传输速率可高达3.125Gbps。 TLK10232 特有一个内置的交叉点开关,此开关可实现冗余输出和简便的数据重路由。每个输出端口(高速或低速)能够被配置成输出来自任一器件输入端口的数据。此切换可通过一个硬件引脚或软件控制来启动,并可被配置成立即切换,或配置成在当前数据包的末尾后出现。这可在不破坏数据包的情况下实现数据源之间的切换。 低速端和高速端数据输入和输出是具有集成端接电阻器的差分电流模式逻辑(CML) 类型。 为了支持不同操作,TLK10232 提供了灵活的计时机制。这些机制包括对使用一个从高速端恢复的外部抖动清除时钟进行计时的支持。此器件还能够在10GBASE-KR 和1GBASE-KX 模式下执行时钟容限补偿(CTC),从而实现异步计时。 TLK10232 为自检和系统诊断用途提供低速端和高速端回路模式。 TLK10232 具有内置模式生成器和验证器以帮助进行系统测试。此器件支持不同PRBS,高/低/混合频率,CRPAT 长/短,CJPAT,和KR 伪随机测试模式的生成和验证以及方波生成。低速端和高速端上支持的模式类型取决于所选择的操作模式。 TLK10232 在高速端和低速端都具有一个集成信号损失(LOS) 检测功能。在输入差分电压摆幅少于LOS 置位阀值的条件下,LOS 被置为有效。 TLK10232 的两个通道是完全独立的。它们可以在不同的基准时钟、不同的数据速率、和不同的串化/解串化比率下运行。 TLK10232 的低速端非常适合与现场可编程栅极阵列(FPGA),特定用途集成电路(ASIC),媒体访问控制器(MAC) 或能够处理较低速率串行数据流的网络处理器对接。高速端非常适合通过光纤、电缆、或者背板接口与远程系统对接。TLK10232 支持SFP 和SFP+ 光模块,以及10GBASE-KR 兼容背板系统的运行。
商品特性
- 双通道多速率收发器支持10GBASE-KR,XAUI,和1GBASE-KX以太网标准支持所有数据速率高达10Gbps
- 通用公共无线接口(CPRI)和开放基站架构协议(OBSAI)
- 在高速端支持数据速率高达10.3125Gbps的多速率串行解串器(SERDES)运行,在低速端支持的数据速率高达5Gbps
- 高速端和低速端上的差分电流模式逻辑(CML) I/O接口
- 到背板、无源和有源铜线缆、或者小尺寸可插拔(SFP)+光模块的接口
- 可选基准时钟每通道(带有多输出时钟选项)
- 集成交叉点开关可实现灵活的信号路由和冗余输出
- 支持数据重定时操作
- 支持伪随机二进制序列(PRBS),随机测试兼容模板(CRPAT),长连续抖动测试图案(CJPAT),高/低/混频模式,和KR伪随机模式生成以及验证,方波生成
- 两个电源:1.0V(内核),以及1.5或1.8V (I/O)
- 无需电源排序
- 发送去加重功能和接收自适应均衡可允许扩展背板/线缆达到高速端和低速端
- 信号损失(LOS)检测
- 支持10G-KR链路协商、前向纠错、自动协商超大数据包
- 支持JTAG;IEEE 1149.1测试接口
- 工业标准管理数据输入输出(MDIO)控制接口
- 65nm高级CMOS技术
- 工业用环境运行温度(-40°C至85°C)
- 功耗:每通道800mW(标称值)
- 器件封装:13mm x 13mm,144引脚塑料球状引脚栅格阵列封装(PBGA),1mm焊球间距
应用领域
- 10GBASE-KR兼容背板连接
- 10兆位以太网交换机、路由器、和网络接口卡
- 私有线缆/背板连接高速点到点传输系统
