CDCL1810ARGZR
CDCL1810ARGZR
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- 描述
- CDCL1810A 具有单个输出使能/禁用功能的 1.8V 1:10 高性能差动时钟缓冲器
- 品牌名称
- TI(德州仪器)
- 商品型号
- CDCL1810ARGZR
- 商品编号
- C2873491
- 商品封装
- VQFN-48-EP(7x7)
- 包装方式
- 编带
- 商品毛重
- 0.247克(g)
商品参数
| 属性 | 参数值 | |
|---|---|---|
| 商品目录 | 时钟缓冲器/驱动器/分配器 | |
| 最大输出频率 | 650MHz |
| 属性 | 参数值 | |
|---|---|---|
| 工作电压 | 1.7V~1.9V | |
| 工作温度 | -40℃~+85℃ |
商品概述
1.8V单电源具有10输出的高性能时钟分配器,低输入输出附加抖动:低至10fs均方根(RMS),低压差分信令(LVDS)输入,100Ω差分片上端接,频率高达650MHz,差分电流模式逻辑(CML)输出、50Ω单端片上端接、频率高达650MHz,两组输出,每组有5个且均具有独立的频分比,输出频率可采用1、2、4、5、8、10、16、20、32、40和80频分比,符合ANSI TIA/EIA-644-A-2001 LVDS标准要求,功耗:410mW(典型值),针对每个输出的输出使能控制,串行数据/串行时钟(SDA/SCL)器件管理接口,48引脚超薄四方扁平无引线(VQFN) (RGZ)封装,工业温度范围: -40°C至 +85°C。
可编程分频器(P0和P1)为输出输入频率比的设置提供了较高的灵活性: FOUT = FIN / P,其中P(P0或P1) = 1、2、4、5、8、10、16、20、32、40、80。
CDCL1810A支持1个差分LVDS时钟输入以及总共10个差分CML输出。CML输出为交流耦合时,可兼容LVDS接收器。
在认真遵守输入电压摆幅和共模电压限制的情况下,CDCL1810A可支持引脚配置和功能中概述的单端时钟输入。
所有器件设置均可通过两线制串口SDA/SCL进行编程。该串口只能承受1.8V电压。
此器件在1.8V电源供电环境下运行,额定工作温度范围为 -40°C至 +85°C。CDCL1810A采用48引脚QFN (RGZ)封装。
商品特性
- 低输入输出附加抖动:低至10fs均方根(RMS)
- 低压差分信令(LVDS)输入,100Ω差分片上端接,频率高达650MHz
- 差分电流模式逻辑(CML)输出、50Ω单端片上端接、频率高达650MHz
- 两组输出,每组有5个且均具有独立的频分比
- 输出频率可采用1、2、4、5、8、10、16、20、32、40和80频分比
- 符合ANSI TIA/EIA-644-A-2001 LVDS标准要求
- 功耗:410mW(典型值)
- 针对每个输出的输出使能控制
- 串行数据/串行时钟(SDA/SCL)器件管理接口
- 48引脚超薄四方扁平无引线(VQFN) (RGZ)封装
- 工业温度范围: -40°C至 +85°C
应用领域
- 针对高速串行解串器(SERDES)的时钟分配
- 针对1G/10G以太网、1X/2X/4X/10X光纤通道、PCI Express、串行ATA、同步光纤网(SONET)、通用公共无线接口(CPRI)和开放式基站架构联盟(OBSAI)等的SERDES基准时钟分配
- 多达1到10的时钟缓冲和扇出
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