CY7C1361B-100AJC
CY7C1361B-100AJC
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- 商品型号
- CY7C1361B-100AJC
- 商品编号
- C2955401
- 商品封装
- LQFP-100(14x20)
- 包装方式
- 管装
- 商品毛重
- 1克(g)
商品参数
| 属性 | 参数值 | |
|---|---|---|
| 商品目录 | 静态随机存取存储器(SRAM) | |
| 接口类型 | 并口(Parallel) | |
| 存储容量 | 9Mbit | |
| 工作电压 | 3.135V~3.6V | |
| 读写时间 | 8.5ns |
| 属性 | 参数值 | |
|---|---|---|
| 工作温度 | 0℃~+70℃ | |
| 工作电流 | 180mA | |
| 待机电流 | 30mA | |
| 功能特性 | 边界扫描(JTAG)功能 |
商品概述
CY7C1361B/CY7C1363B分别是3.3V、256K x 36和512K x 18的同步直通静态随机存取存储器(SRAM),旨在以最少的胶合逻辑与高速微处理器接口。时钟上升沿的最大访问延迟为6.5 ns(133-MHz版本)。一个2位片上计数器捕获突发中的第一个地址,并在突发访问的其余部分自动递增地址。所有同步输入由正边沿触发的时钟输入(CLK)控制的寄存器选通。同步输入包括所有地址、所有数据输入、地址流水线片选(CE1上划线)、深度扩展片选(CE2和CE3上划线)、突发控制输入(ADSC、ADSP和ADV)、写使能(BWx上划线和BWE)和全局写(GW)。异步输入包括输出使能(OE)和ZZ引脚。CY7C1361B/CY7C1363B允许通过MODE输入引脚选择交错或线性突发序列。突发访问可以通过处理器地址选通(ADSP)或缓存控制器地址选通(ADSC)输入启动。地址推进由地址推进(ADV)输入控制。该器件由+3.3V核心电源供电,所有输出可以使用+2.5V或+3.3V电源供电。所有输入和输出均符合JEDEC标准JESD8 - 5。
商品特性
- 支持133-MHz总线操作
- 256K x 36/512K x 18 共同I/O
- 3.3V核心电源供应,容差为-5%和+10% (VDD)
- 2.5V或3.3V I/O电源供应 (VDDQ)
- 快速时钟到输出时间:6.5 ns(133-MHz版本)、7.5 ns(117-MHz版本)、8.5 ns(100-MHz版本)
- 提供高性能2-1-1访问速率
- 用户可选的突发计数器,支持交错或线性突发序列
- 独立的处理器和控制器地址选通
- 同步自定时写入
- 异步输出使能
- 提供JEDEC标准的100引脚TQFP、119球BGA和165球fBGA封装,TQFP封装提供2和3芯片使能选项
- 针对BGA和fBGA封装的JTAG边界扫描
- “ZZ”睡眠模式选项
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