ENC424J600T-I/PT
ENC424J600T-I/PT
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- 描述
- 独立的10/100以太网控制器,具有SPI或并行接口。符合IEEE 802.3标准的快速以太网控制器,集成MAC和10/100Base-T PHY,具备硬件安全加速引擎,24KB的发送/接收数据包缓冲SRAM。支持一个10/100Base-T端口,具有自动极性检测和校正功能,支持自动协商、暂停控制帧(包括自动发送和接收流量控制),支持半双工和全双工操作,可编程自动重传碰撞数据包,可编程填充和CRC生成,可编程自动拒绝错误和短数据包,工厂预编程唯一MAC地址。MAC支持单播、多播和广播数据包,支持混杂接收,可编程模式匹配,可编程过滤多种数据包格式;PHY具有波形整形输出滤波器、内部环回模式、能量检测掉电模式
- 品牌名称
- MICROCHIP(美国微芯)
- 商品型号
- ENC424J600T-I/PT
- 商品编号
- C630731
- 商品封装
- TQFP-44(10x10)
- 包装方式
- 编带
- 商品毛重
- 0.55克(g)
商品参数
| 属性 | 参数值 | |
|---|---|---|
| 商品目录 | 以太网控制器 | |
| 通道数 | 1 | |
| 工作电压 | 3.3V | |
| 集成PHY | 是 | |
| 工作温度 | -40℃~+85℃ |
| 属性 | 参数值 | |
|---|---|---|
| 通信接口 | SPI | |
| 存储空间 | 24KB | |
| 以太网速率标准 | 10BASE-T;100BASE-TX | |
| 数据速率 | 10Mbit/s;100Mbit/s |
商品特性
- 符合IEEE 802.3标准的快速以太网控制器
- 集成MAC和10/100Base-T PHY
- 硬件安全加速引擎
- 24KB的发送/接收数据包缓冲SRAM
- 支持一个10/100Base-T端口,具备自动极性检测与校正功能
- 支持自动协商
- 支持暂停控制帧,包括自动发送和接收流量控制
- 支持半双工和全双工操作
- 可编程的冲突自动重传功能
- 可编程的填充和CRC生成功能
- 可编程的错误和短数据包自动拒绝功能
- 工厂预编程的唯一MAC地址
- MAC:支持单播、多播和广播数据包;支持混杂模式接收;可编程模式匹配;支持对多种数据包格式进行可编程过滤,包括魔法包、单播、多播、广播、特定数据包匹配、目的地址哈希匹配或任意数据包
- PHY:波形整形输出滤波器;内部环回模式;能量检测掉电模式
- 可用的MCU接口:具有增强操作码集的14Mbit/s SPI接口(44引脚和64引脚封装);8位复用并行接口(44引脚和64引脚封装);8位或16位复用或解复用并行接口(仅64引脚封装)
- 安全引擎:高性能模块化幂运算引擎,操作数可达1024位;支持RSA和Diffie-Hellman密钥交换算法;高性能AES加密/解密引擎,支持128位、192位或256位密钥;具备硬件AES ECB、CBC、CFB和OFB模式功能;具备软件AES CTR模式功能;快速MD5哈希计算;快速SHA-1哈希计算
- 缓冲区:可配置的发送/接收缓冲区大小;硬件管理的循环
