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8V19N490BDGI

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品牌名称: RENESAS(瑞萨)/IDT
商品型号: 8V19N490BDGI
商品编号: C3612493
商品封装: CABGA-100(11x11)
包装方式: 托盘
商品毛重: 1克(g)

商品参数

商品概述

8V19N490是一款完全集成的FemtoClock NG抖动衰减器和时钟合成器，专为无线基站射频设备板提供高性能时钟解决方案，用于调节和管理频率/相位。该器件针对GSM、WCDMA、LTE和LTE-A射频板实现所需的卓越相位噪声性能进行了优化。该器件支持JESD204B子类0和1时钟。

两级PLL架构同时支持抖动衰减和频率倍增。第一级PLL是抖动衰减器，使用外部VCxO以实现最佳的相位噪声特性。第二级PLL锁定在VCxO-PLL输出信号上并合成目标频率。

该器件支持从选定的VCO生成高频时钟，以及低频同步信号（SYSREF）。SYSREF信号在内部与时钟信号同步。存在延迟功能，用于实现系统参考和时钟信号之间的对齐和受控相位延迟，以及对齐/延迟各个输出信号。四个冗余输入被监控活动状态。提供了四种可选择的时钟切换模式，以处理时钟输入故障场景。自动锁定、单独可编程的输出频率分频器和相位调整功能增加了灵活性。

该器件通过3线SPI接口进行配置，并在内部寄存器以及通过锁定检测（LOCK）输出报告锁定和信号丢失状态。内部状态位更改也可以通过nINT输出报告。8V19N490非常适合驱动无线基础设施、雷达/成像以及仪器/医疗应用中的转换器电路。该器件是IDT高性能时钟系列的一员。

商品特性

支持JESD204B的高性能时钟RF-PLL
优化了低相位噪声：-150dBc/Hz（800kHz偏移；245.76MHz时钟）
典型集成相位噪声为80fs RMS（12kHz–20MHz）
双PLL架构
第一阶段PLL使用外部VCXO以降低时钟抖动
第二阶段PLL采用内部FemtoClock NG PLL：2949.12MHz
六个输出通道，总共19个输出，包括：
- 四个JESD204B通道（设备时钟和SYSREF输出），每个通道有两个、四个或六个输出
- 一个时钟通道，有两个输出
- 一个VCXO输出
可配置的整数时钟频率分频器
支持的时钟输出频率包括：2949.12, 1474.56, 983.04, 491.52, 245.76, 和 122.88MHz
低功耗LVPECL/LVDS输出支持可配置信号幅度、直流和交流耦合以及LVPECL, LVDS线路端接技术
相位延迟电路：
- 时钟相位延迟，256步进，每步339ps，范围从0到86.466ns
- 单独的SYSREF相位延迟，8步进，每步169ps
- 额外的单独SYSREF精细相位延迟，25ps步进
- 全局SYSREF信号延迟，256步进，每步339ps，范围从0到86.466ns
冗余输入时钟架构，具有四个输入，包括：
- 输入活动监测
- 手动和自动故障触发时钟选择模式
- 优先级控制的时钟选择
- 数字保持和无缝切换
- 差分输入接受LVDS和LVPECL信号
SYSREF生成模式包括内部和外部触发模式用于JESD204B
电源电压：3.3V
SPI和控制I/O电压：1.8V/3.3V（可选）
封装：11 x 11mm 100-CABGA
温度范围：-40℃至+85℃

应用领域

无线基础设施应用：GSM、WCDMA、LTE、LTE-A
理想的时钟驱动器，适用于对抖动敏感的ADC和DAC电路
低相位噪声时钟生成
以太网线卡
雷达和成像
仪器和医疗应用

数据手册PDF

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	属性	参数值
	商品目录	时钟消抖
	最大输出频率	2.949GHz
	工作电压	3.3V

	属性	参数值
	输出电平	LVDS；LVPECL
	输出通道数	1
	工作温度	-40℃~+85℃