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TMS32C6205DGWTA200实物图
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温馨提醒:图片仅供参考,商品以实物为准

TMS32C6205DGWTA200

TMS32C6205DGWTA200

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描述
TMS320C6205 定点数字信号处理器
品牌名称
TI(德州仪器)
商品型号
TMS32C6205DGWTA200
商品编号
C2871652
商品封装
NFBGA-288​
包装方式
编带
商品毛重
1克(g)

商品参数

属性参数值
商品目录数字信号处理器(DSP/DSC)
属性参数值
工作温度-40℃~+105℃

商品特性

  • 5纳秒指令周期时间
  • 200兆赫时钟频率
  • 每周期八条32位指令
  • 1600 MIPS
  • VelociTITM 高级超长指令字 (VLIw) TMS320C62xTM DSP 核心
  • 八个高度独立的功能单元:
    • 六个算术逻辑单元 (ALU)(32/40位)
    • 两个16位乘法器(32位结果)
  • 带有32个32位通用寄存器的加载存储架构
  • 指令打包减少代码大小
  • 所有指令都是条件性的
  • 字节寻址(8位、16位、32位数据)
  • 8位溢出保护
  • 饱和
  • 位字段提取、设置、清除
  • 位计数
  • 规范化
  • 1M位片上SRAM
  • 512K位内部程序/缓存(16K 32位指令)
  • 512K位双访问内部数据(64K字节)—组织为两个32K字节块以提高并发性
  • 32位外部存储器接口 (EMIF)
  • 无需胶合逻辑接口到同步存储器:SDRAM 或 SBSRAM
  • 无需胶合逻辑接口到异步存储器:SRAM 和 EPROM
  • 52M字节可寻址外部存储空间
  • 四通道引导加载
  • 直接内存访问 (DMA) 控制器,带有一个辅助通道
  • 灵活的锁相环 (PLL) 时钟生成器
  • 32位/33兆赫外设组件互连 (PCI) 主/从接口
  • 符合:PCI规范2.2 电源管理接口1.1 满足PC99要求
  • PCI访问所有片上RAM、外设和外部存储器(通过EMIF)
  • 四个8深x32宽FIFO,用于高效PCI总线数据传输
  • 3.3/5伏PCI操作
  • 三个PCI总线地址寄存器:可预取内存、不可预取内存、I/O
  • 支持4线串行EEPROM接口
  • 在DSP程序控制下的PCI中断请求
  • 通过PCI I/O周期的DSP中断
  • 两个多通道缓冲串行端口 (McBSPs)
  • 直接接口到T1/E1、MVIP、SCSA帧处理器
  • ST总线切换兼容
  • 每个最多256通道
  • AC97兼容
  • 串行外设接口 (SPI) 兼容(摩托罗拉)
  • 两个32位通用定时器
  • IEEE-1149.1 (JTAG) 边界扫描兼容
  • 288引脚MicroStar BGATM封装(GHK和ZHK后缀)
  • 0.15微米/5层金属工艺—CMOS技术
  • 3.3伏I/O,1.5伏内部,PCI I/O引脚5伏电压容差
  • 在200兆赫时钟频率下最高可达1600百万条指令每秒 (MIPS)
  • 32个32位字长的通用寄存器
  • 八个高度独立的功能单元
  • 六个算术逻辑单元 (ALU),实现高度并行
  • 两个16位乘法器,产生32位结果
  • 每周期两个乘累加 (MAC),总共400百万次MAC每秒 (MMACS)
  • 应用特定硬件逻辑、片上存储器和附加片上外设
  • 64K字节用户可配置为缓存或内存映射程序空间的程序存储器
  • 两个32K字节的数据RAM块
  • 两个多通道缓冲串行端口 (McBSPs)
  • 两个通用定时器
  • 外设组件互连 (PCI) 模块,支持33兆赫主/从接口和4线串行EEPROM接口
  • 无需胶合逻辑的外部存储器接口 (EMIF),能够接口到SDRAM或SBSRAM和异步外设
  • 完整的开发工具集,包括新的C编译器、汇编优化器和windows调试器接口
  • 64K字节内部程序存储器
  • 64K字节内部数据存储器
  • 200兆赫频率
  • 5纳秒周期时间
  • 1.5伏核心电压
  • 3.3伏I/O电压
  • PCI I/O引脚5.0伏电压容差
  • PLL选项:旁路 (x1),x4,x6,x7,x8,x9,x10,x11
  • 288引脚MicroStar BGATM封装(GHK/ZHK)
  • 0.15微米工艺技术
  • 产品状态:生产数据 (PD)
  • 设备零件号:TMX320C6205GHK, TMX320C6205ZHK
  • CPU获取256位宽的指令获取包
  • 每个时钟周期可以向八个功能单元提供最多八条32位指令
  • 可变长度执行包
  • 两组功能单元,每组四个单元和一个寄存器文件
  • 32个通用寄存器
  • 加载存储架构
  • 使用线性或循环寻址的间接寻址模式,带有5位或15位偏移
  • 所有指令都是条件性的
  • 两个.M功能单元专门用于乘法
  • 两个.S和.L功能单元执行一组通用的算术、逻辑和分支功能
  • 指令通过“1”位在最低有效位 (LSB) 位置链接在一起
  • 执行包以每时钟周期一个的速度分派到各自的功能单元
  • 存储在32位寄存器中的结果可以作为字节或半字移动到内存中
  • 加载和存储指令是字节、半字或字寻址的
  • MAP 0和MAP 1配置的内存映射地址范围
  • 内存映射包括外部存储器接口 (EMIF)、内部程序RAM和各种外设寄存器
  • 用于CPU(DSP核心)和外设信号的信号组
  • JTAG仿真信号

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(90个/圆盘,最小起订量 1 个)
起订量:1 个90个/圆盘

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