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V96SSC-33LP实物图
  • V96SSC-33LP商品缩略图

温馨提醒:图片仅供参考,商品以实物为准

V96SSC-33LP

V96SSC-33LP

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品牌名称
QuickLogic
商品型号
V96SSC-33LP
商品编号
C19311076
包装方式
袋装
商品毛重
1克(g)

商品参数

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参数完善中

商品概述

V96SSC 高集成系统控制器是一种单芯片设备,简化了基于i960Sx、i960Jx或PPC401Gx嵌入式微处理器的系统设计。V96SSC用一个高集成度的器件替换了许多低集成度的组件。除了简化内存和外设控制之外,V96SSC还包括构建高性能i960或PPC401Gx系统所需的许多外设:DMA通道、同步/异步串行端口、通用和系统心跳定时器、位I/O端口以及中断控制器。

几乎所有基于i960或PowerPC处理器的系统都需要DRAM来存储代码和数据。V96SSC包含一个高性能的DRAM控制器,该控制器可编程以适应各种速度和架构的DRAM。八个片选/选通进一步简化了外设/内存连接。每个选择都有可编程时序,并提供了总共四个等待状态生成器。

此外,V96SSC还包括一些增强系统完整性的特殊功能。总线监视定时器可以防止在访问未填充内存时系统挂起。还包含了一个看门狗定时器,用于从软件故障中恢复。由于其小巧的尺寸和无需额外粘合逻辑的接口,V96SSC提供了集成处理器的最佳特性,而不会影响性能。

商品特性

  • 直接接口到 i960Sx/Jx 和 PPC401Gx 处理器
  • 高性能突发 DRAM 控制器
  • 双通道飞越 DMA 控制器
  • 串行通信单元
  • 可编程芯片选择/选通生成
  • 支持8/16位启动 PROM
  • 两个32位通用定时器
  • 脉冲宽度调制功能
  • 16个通用 I/O 位
  • 八个输入端口和八个输出端口
  • 中断控制单元
  • 局部总线速度高达33MHz
  • 低成本100针 EIAJ PQFP 封装
  • 对于基于 i960Sx 和 i960Jx 的设计,上市时间最快
  • 简化基于 i960Sx、i960Jx 或 PPC401Gx 嵌入式微处理器的系统设计
  • 用单一高集成度设备替代许多低集成度组件
  • 包括DMA通道、同步/异步串行端口、通用和系统心跳定时器、位I/O端口以及中断控制器
  • 可编程高性能DRAM控制器,可适应广泛的DRAM速度和架构
  • 具有可编程时序的八个芯片选择/选通及四个等待状态生成器
  • 总线监视计时器防止访问未填充内存时系统挂起
  • 看门狗计时器以从软件故障中恢复
  • 小尺寸和无胶接口
  • 直接 i960 和 PPC401Gx 处理器总线接口单元
  • 突发 DRAM 控制器
  • DMA 控制器
  • 串行通信单元
  • 芯片选择/选通单元
  • 通用定时器/计数器
  • 系统看门狗和系统心跳定时器
  • 中断控制单元
  • I/O 控制单元和内部信号多路复用器
  • 支持快速页模式、扩展数据输出以及Ramtron增强型DRAM架构
  • 每个最多64MByte的两个DRAM银行(总共128MBytes)
  • 可编程DRAM银行地址基址和大小
  • 可编程行列复用模式
  • 可编程RASx和CASx时序
  • 支持16位和32位DRAM阵列
  • 支持最长可达256字节事务的扩展突发周期
  • 可编程页面缓存以消除对同一DRAM页面后续访问的RAS周期
  • 可编程刷新计数器
  • 在33MHz下读取性能为1-0-0-0,写入性能为0-0-0-0
  • 两个独立的DMA通道
  • DMA缓冲区开始和结束地址是可编程的
  • 可编程油门计数用于长传输
  • 串行通信单元提供同步和异步模式
  • 双缓冲传输和接收
  • 接收缓冲区满、发送缓冲区空、缓冲区溢出错误和帧错误时产生中断
  • 同步(SPI)模式下具有可编程数据字长
  • 时钟参考可以是独立波特率发生器或通用定时器1
  • 八个输出选通/选择作为I/O多路复用器的输出引脚可用
  • 八个带有基址、大小和地区数据宽度选项的存储器解码寄存器
  • 可编程同步模式选通及时序等待状态生成
  • 每个八个芯片选择/选通输出引脚被分配给四个可编程存储器范围之一
  • 两个相同的32位通用定时器
  • 定时器从32位预加载值每时钟周期递减
  • 终点计数时生成可屏蔽中断
  • 外部输入(Tix)和外部输出引脚(TOx)
  • 模式:终点计数时锁存低电平、短脉冲低电平、长脉冲低电平、终点计数时切换、脉冲宽度调制、单次触发
  • 用于从软件崩溃中恢复的看门狗定时器
  • 为实时操作系统提供的固定延迟周期性中断
  • 总线监视定时器监控由外部主机发起的每个总线访问的READY引脚
  • 中断控制单元管理所有片上和多达8个外部请求的中断
  • 8个独立的单比特输入或输出端口
  • 输入端口提供外部中断请求
  • 通过写入输出端口寄存器设置输出端口
  • I/O多路复用器允许非必要I/O信号被多路复用到IO[15:0]引脚上
  • 特别支持启动ROM设备
  • 自动检测针对每个处理器特定的启动范围
  • 对于使用8位启动ROM的i960Sx系统,字节数据自动导向AD总线的适当半部分
  • 100针EIAJ PQFP封装的引脚布局
  • 封装的机械尺寸
  • 处理器接口信号:A31, A[26:16], AD[15:0], ALE, ADS, BE[1:0], BLAST, W/R, HOLD, HLDA, INT, READY, BTYPE[1:0]

数据手册PDF

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