F28P650SK7NMRR

TMS320F28P65x (F28P65x) 是 C2000 实时微控制器系列中的一款可扩展、超低延迟器件，旨在提高电力电子设备的效率，包括高功率密度、高开关频率，并支持使用 GaN 和 SiC 技术。这些应用包括工业电机驱动（如牵引逆变器电机控制、HVAC 电机控制、移动机器人电机控制）、光伏逆变器（如中央逆变器、微型逆变器、串式逆变器）、数字电源、HEV/EV 动力总成、电动汽车充电基础设施、储能系统、工业与协作机器人、工业机械和机床、工业移动机器人。实时控制子系统基于 TI 的 32 位 C28x DSP 内核，可针对从片上闪存或 SRAM 运行的浮点或定点代码在每个内核中提供 200MIPS 的信号处理性能，相当于基于 Cortex - M7 的器件上的 400MHz 处理能力。三角函数加速器 (TMU) 和循环冗余校验 (VCRC) 扩展指令集进一步增强了 C28x CPU 的性能，利用扩展指令集实现 IEEE 双精度 64 位浮点数学。控制律加速器 (CLA) 使每个内核具有额外 200MIPS 的独立处理能力，相当于基于 Cortex - M7 的器件上的 280MHz 处理能力。次级 C28x CPU 中添加了锁步双 CPU 比较器选项以及 ePIE 和 DMA，用于检测永久性和瞬态故障。实时固件更新 (LFU) 的硬件增强功能被添加到 F28P65x 中以实现快速上下文切换。高性能模拟块与处理单元和控制单元紧密集成，提供出色的实时信号链性能。模数转换器 (ADC) 经过增强，具有多达 40 个模拟通道，其中 22 个具有通用输入/输出 (GPIO) 功能，简化了过采样实施，添加了硬件冗余校验器以比较多个 ADC 模块的 ADC 转换结果。三十六个与频率无关的 PWM 均具有高分辨率，支持控制多个功率级，并通过最小死区逻辑 (MINDL) 和非法组合逻辑 (ICL) 特性增强。通过加入可配置逻辑块 (CLB)，用户可以添加自定义逻辑并集成类似 FPGA 的功能。EtherCAT 子器件控制器和其他业界通用协议（如 CAN FD 和 USB 2.0）均可使用，快速串行接口 (FSI) 可跨隔离边界实现高达 200Mbps 的稳健通信。F28P65x 还提供各种信息安全机制，支持硬件加密、安全 JTAG 和安全启动等功能。

• 实时处理：最多包含三个 CPU，两个 32 位 C28x DSP CPU 和一个 CLA CPU，均在 200MHz 下运行；在实时信号链性能方面，提供的总处理能力相当于基于 1000MHz Arm Cortex - M7 的器件；C28x DSP 架构包含 IEEE 754 双精度（64 位）浮点单元 (FPU)、三角函数数学单元 (TMU)、快速整数除法 (FINTDIV)、CRC 引擎和指令 (VCRC)；控制律加速器 (CLA) CPU 支持 IEEE 754 单精度浮点，独立于 C28x CPU 执行代码。
• 存储器：带有 5 个闪存组的 1.28MB CPU 可映射闪存（受 ECC 保护）；248KB RAM（增强型奇偶校验保护）；外部存储器接口 (EMIF)，支持 ASRAM、SDRAM 或 ASIC/FPGA。
• 模拟子系统：三个模数转换器 (ADC)，16 位模式下每个为 1.19MSPS，12 位模式下每个为 3.92MSPS，多达 40 个单端输入或 19 个差分输入，每个 ADC 上有独立的采样保持 (S/H) 电路，有转换的硬件后处理，支持硬件过采样（高达 128 倍）和欠采样模式，带累积、均值计算和异常抑制，有 24 个冗余输入通道，为功能安全应用提供转换结果的自动比较功能；11 个具有 12 位数模转换器 (DAC) 基准的窗口比较器，带斜率补偿的 DAC 支持峰值电流和谷值电流模式控制，有内部温度传感器和 ADC 基准的连接选项；两个 12 位缓冲 DAC 输出。
• 控制外设：36 个脉宽调制器 (PWM) 通道，全部具有 150ps 高分辨率功能 (HRPWM)，支持最小死区逻辑 (MINDB)、非法组合逻辑 (ICL) 及其他特殊功能（如二极管仿真[DE]），支持启用矩阵转换器、多级转换器和谐振转换器，无需额外的外部逻辑；7 个增强型捕获 (eCAP) 模块，其中 2 个提供高分辨率捕获 (HRCAP)，有两个新的监控单元用于显示边沿、脉宽和周期，可与 ePWM 选通和跳闸事件进行耦合，增加了 256 个输入以提供更多捕获选项，有新的 ADC SOC 生成功能，eCAP 也可用于额外的 PWM；6 个增强型正交编码器脉冲 (eQEP) 模块；16 个 Σ - Δ 滤波器模块 (SDFM) 输入通道，每个通道 2 个独立滤波器；嵌入式图形发生器 (EPG)；可配置逻辑块包含 6 个逻辑块，用于增强现有外设功能或定义自定义逻辑，以减少或消除外部 CPLD/FPGA，支持编码器接口，无需 FPGA，支持为功率转换生成自定义的 PWM。
• 通信外设：EtherCAT 从属器件（或 SubDevice）控制器 (ESC)；USB 2.0 (MAC + PHY)；快速串行接口 (FSI) 可跨隔离实现高达 200Mbps 的数据交换；4 个高速（高达 50MHz）SPI 端口；2 个串行通信接口 (SCI)（支持 UART）；2 个高速 (25Mbps) 通用异步接收器/发送器 (UART)；两个 I2C 接口 (400Kbps)；通过 SPI/SCI/I2C 提供外部引导选项；2 个 UART 兼容的本地互连网络 (LIN) 模块（支持 SCI）；电源管理总线 (PMBus) 接口（支持 I2C）；1 个控制器局域网 (CAN/DCAN)；2 个具有灵活数据速率的 CAN FD/MCAN 控制器局域网。
• 系统外设：2 个 6 通道直接存储器存取 (DMA) 控制器；185 个独立可编程多路复用通用输入/输出 (GPIO) 引脚；扩展外设中断控制器 (ePIE)；支持低功耗模式 (LPM)；嵌入式实时分析和诊断 (ERAD)；后台 CRC (BGCRC)。
• 安全外设：高级加密标准（AES - 128、192、256）加速器；安全性方面有 JTAGLOCK、零引脚引导、双区域安全；唯一标识 (UID) 号；采用倒数比较法实现更简易的实施；C28x CPU 2 上的锁步模式；存储器开机自检 (MPOST)；非锁步器件上的硬件内置自检 (HWBIST)，符合功能安全标准，专为功能安全应用开发，可提供用于 ISO 26262 和 IEC 61508 系统设计的文档，系统功能符合 ASIL D 和 SIL 3 等级要求，硬件完整性符合 ASIL B 和 SIL 2 要求；已通过 TÜV SÜD 的 ISO 26262 认证 ASIL B，通过 TÜV SÜD 的 IEC 61508 认证 SIL 2。
• 时钟和系统控制：2 个内部 10MHz 振荡器；片上晶体振荡器；2 个 APLL、BOR、冗余中断向量 RAM；窗口化看门狗计时器模块；丢失时钟检测电路；双时钟比较器 (DCC)；实时固件更新 (LFU)，无论在下电还是上电的情况下，都支持新旧固件快速切换；1.2V 内核、3.3V I/O 设计，内部 VREG 可生成 1.2V 电压，有欠压复位 (BOR) 电路。
• 封装选项：无铅，绿色环保封装；256 焊球 New Fine Pitch Ball Grid Array (nFBGA)[ZEJ 后缀]，13mm x 13mm/0.8mm 间距；176 引脚 PowerPAD Thermally Enhanced Low - profile Quad Flatpack (HLQFP) [PTP 后缀]，26mm × 26mm/0.5mm 间距；169 焊球 New Fine Pitch Ball Grid Array (nFBGA)[NMR 后缀]，9mm x 9mm/0.65mm 间距；100 引脚 PowerPAD Thermally Enhanced Thin - Quad Flatpack (HTQFP) [PZP 后缀]，16mm × 16mm/0.5mm 间距。
• 温度：环境温度 (TA)：–40°C ~ 125°C（工业级和汽车级认证）

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