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ATF1502AS-10AU44

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描述: ATF1502AS(L)是一款高性能、高密度的复杂可编程逻辑器件（CPLD），采用了成熟的电可擦除技术。它拥有32个逻辑宏单元和多达36个输入，能够轻松集成多个TTL、SSI、MSI、LSI和传统PLD的逻辑。ATF1502AS(L)增强的路由开关矩阵增加了可用门数，提高了引脚锁定设计修改成功的几率。ATF1502AS(L)最多有32个双向I/O引脚和4个专用输入引脚，具体数量取决于所选的器件封装类型。每个专用引脚可作为全局控制信号、寄存器时钟、寄存器复位或输出使能。这些控制信号可在每个宏单元中单独选择使用。32个宏单元中的每一个都会产生一个内部反馈，该反馈会连接到全局总线。每个输入和I/O引脚也会接入全局总线。然后，每个逻辑块中的开关矩阵会从全局总线中选择40个独立信号。每个宏单元还会产生一个反馈逻辑项，连接到区域总线。ATF1502AS(L)宏单元之间的级联逻辑能够快速、高效地生成复杂逻辑功能。ATF1502AS(L)包含4条这样的逻辑链，每条逻辑链最多可创建具有40个乘积项扇入的和项逻辑。ATF1502AS(L)宏单元具有足够的灵活性，能够支持高速运行的高度复杂逻辑功能。宏单元由五个部分组成：乘积项和乘积项选择多路复用器或/异或/级联逻辑触发器输出选择和使能逻辑阵列输入编译器会自动禁用未使用的乘积项，以降低功耗。编程后的安全熔丝可保护ATF1502AS(L)的内容。用户可访问两个字节（16位）的用户签名，用于存储项目名称、部件编号、版本或日期等信息。无论安全熔丝状态如何，都可访问用户签名。ATF1502AS(L)器件是一种在系统可编程（ISP）器件。它使用行业标准的4引脚JTAG接口（IEEE Std. 1149.1），并完全符合JTAG的边界扫描描述语言（BSDL）。ISP允许在不将器件从印刷电路板上移除的情况下进行编程。除了简化制造流程外，ISP还允许通过软件在现场进行设计修改。ATF1502AS(L)提供对所有输入和I/O引脚进行编程的选项，以便使用引脚保持电路。当任何引脚被驱动为高电平或低电平，然后处于浮空状态时，它将保持在之前的高电平或低电平。该电路可防止未使用的输入和I/O线路浮空到中间电压电平，从而避免不必要的功耗和系统噪声。保持电路无需外部上拉电阻，并消除了它们的直流功耗。ATF1502AS(L)具有多种内置的速度和电源管理功能。当没有逻辑转换发生时，ATF1502AS(L)中的电路会自动将器件置于低功耗待机模式。这不仅能在非活动期间降低功耗，还能为大多数运行速度低于50MHz的系统应用按比例节省功耗。此功能可作为设计选项进行选择。为进一步降低功耗，每个ATF1502AS(L)宏单元都具有低功耗位功能。该功能允许对单个宏单元进行配置，以实现最大程度的节能。此功能可作为设计选项进行选择。ATF1502AS(L)还具有可选的掉电模式。在这种模式下，电流降至10mA以下。
品牌名称: MICROCHIP(美国微芯)
商品型号: ATF1502AS-10AU44
商品编号: C1521098
商品封装: TQFP-44(10x10)
包装方式: 托盘
商品毛重: 0.001克(g)

商品参数

商品概述

爱特梅尔（Atmel）的ATF1502AS(L)是一款高性能、高密度的复杂可编程逻辑器件（CPLD），采用了成熟的电可擦除技术。它拥有32个逻辑宏单元和多达36个输入，能够轻松集成多个TTL、SSI、MSI、LSI和传统PLD的逻辑。ATF1502AS(L)增强的路由开关矩阵增加了可用门数，提高了引脚锁定设计修改成功的几率。 ATF1502AS(L)最多有32个双向I/O引脚和4个专用输入引脚，具体数量取决于所选的器件封装类型。每个专用引脚可作为全局控制信号、寄存器时钟、寄存器复位或输出使能。这些控制信号可在每个宏单元中单独选择使用。 32个宏单元中的每一个都会产生一个内部反馈，该反馈会连接到全局总线。每个输入和I/O引脚也会接入全局总线。然后，每个逻辑块中的开关矩阵会从全局总线中选择40个独立信号。每个宏单元还会产生一个反馈逻辑项，连接到区域总线。ATF1502AS(L)宏单元之间的级联逻辑能够快速、高效地生成复杂逻辑功能。ATF1502AS(L)包含4条这样的逻辑链，每条逻辑链最多可创建具有40个乘积项扇入的和项逻辑。 ATF1502AS(L)宏单元具有足够的灵活性，能够支持高速运行的高度复杂逻辑功能。宏单元由五个部分组成：乘积项和乘积项选择多路复用器或/异或/级联逻辑触发器输出选择和使能逻辑阵列输入编译器会自动禁用未使用的乘积项，以降低功耗。编程后的安全熔丝可保护ATF1502AS(L)的内容。用户可访问两个字节（16位）的用户签名，用于存储项目名称、部件编号、版本或日期等信息。无论安全熔丝状态如何，都可访问用户签名。 ATF1502AS(L)器件是一种在系统可编程（ISP）器件。它使用行业标准的4引脚JTAG接口（IEEE Std. 1149.1），并完全符合JTAG的边界扫描描述语言（BSDL）。ISP允许在不将器件从印刷电路板上移除的情况下进行编程。除了简化制造流程外，ISP还允许通过软件在现场进行设计修改。 ATF1502AS(L)提供对所有输入和I/O引脚进行编程的选项，以便使用引脚保持电路。当任何引脚被驱动为高电平或低电平，然后处于浮空状态时，它将保持在之前的高电平或低电平。该电路可防止未使用的输入和I/O线路浮空到中间电压电平，从而避免不必要的功耗和系统噪声。保持电路无需外部上拉电阻，并消除了它们的直流功耗。 ATF1502AS(L)具有多种内置的速度和电源管理功能。当没有逻辑转换发生时，ATF1502AS(L)中的电路会自动将器件置于低功耗待机模式。这不仅能在非活动期间降低功耗，还能为大多数运行速度低于50MHz的系统应用按比例节省功耗。此功能可作为设计选项进行选择。为进一步降低功耗，每个ATF1502AS(L)宏单元都具有低功耗位功能。该功能允许对单个宏单元进行配置，以实现最大程度的节能。此功能可作为设计选项进行选择。 ATF1502AS(L)还具有可选的掉电模式。在这种模式下，电流降至10mA以下。

商品特性

高密度、高性能、电可擦除复杂可编程逻辑器件
32个宏单元
每个宏单元5个乘积项，每个宏单元最多可扩展至40个
44引脚
最大引脚到引脚延迟7.5ns
最高125MHz的寄存器操作
增强的路由资源
通过JTAG实现系统内可编程（ISP）
灵活的逻辑宏单元
D/T锁存器可配置触发器
全局和单个寄存器控制信号
全局和单个输出使能
可编程输出转换速率
可编程输出开漏选项
通过将寄存器与COM输出内置实现最大逻辑利用率
先进的电源管理功能
“L”版本自动10μA待机
引脚控制1mA待机模式
可编程引脚保持输入和I/O
每个宏单元的低功耗功能
适用于商业和工业温度范围
提供44引脚PLCC和44引脚TQFP封装
100%测试
完全可重新编程
10,000次编程/擦除周期
20年数据保留
2000V ESD保护
200mA抗闩锁能力
符合IEEE Std. 1149.1 - 1990和1149.1a - 1993的JTAG边界扫描测试
支持PCI兼容
安全熔丝功能
环保（无铅/无卤/符合RoHS标准）封装选项
改进的连接性（额外的反馈路由、备用输入路由）
输出使能乘积项
D锁存器模式
任何宏单元内带寄存器反馈的组合输出
三个全局时钟引脚
全局时钟、输入和I/O上的ITD（输入转换检测）电路（“L”版本）
来自乘积项的快速寄存器输入
可编程“引脚保持”选项
VCC上电复位选项
JTAG引脚TMS和TDI上的上拉选项
先进的电源管理功能
输入转换检测掉电（“L”版本）
单个宏单元电源选项
禁用全局时钟、输入和I/O上的ITD

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	属性	参数值
	商品目录	可编程逻辑器件(CPLD/FPGA)
	类型	其它PLD
	工作电压(VCCIO)	4.5V~5.5V

	属性	参数值
	逻辑单元数	-
	逻辑阵列块数量	-
	工作温度	-40℃~+85℃